om stigende / faldende tidspunktet for CLK

S

spring1860

Guest
hej
Jeg har et spørgsmål af stigende / faldende tidspunktet for CLK overgang kondensator ckts, for eksempel til en 40MHz CLK, hvor mange der stiger / falder tid er bedst, er der nogen kriterier?
thx mange.

 
der er kun overvejelser om EMC.

for design, kan du ignorere det.

 
Nå, det også har virkninger charge injektion (hvis uret er meget langsom).

 
lladnar23 skrev:

Nå, det også har virkninger charge injektion (hvis uret er meget langsom).
 
Hej,
Her er en bog
http://www.edaboard.com/viewtopic.php?p=950565 # 950.565

 
har du noget materiale om EMC-overvejelser i IC design?

 
master_picengineer skrev:

Hej,

Her er en bog

http://www.edaboard.com/viewtopic.php?p=950565 # 950.565
 

Welcome to EDABoard.com

Sponsor

Back
Top